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一种基于FPGA的全数字锁相环设计

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【作者】 陈华君杨涛

【Author】 CHEN Hua-jun, YANG Tao (UESTC, Chengdu 611731, China)

【机构】 电子科技大学

【摘要】 给出了使用verilog HDL语言对锁相环进行基于FPGA的全数字系统设计,以及对其性能进行分析和计算机仿真的具体方法。该方法采用综合仿真工具QuartusⅡ8.0来对数字锁相环进行输入设计、功能时序仿真及器件编程。仿真结果表明:该方法可通过在传统数字锁相环基本结构的基础上增加自动变模控制模块来有效解决缩短捕捉时间和减小同步误差之间的矛盾。

【基金】 中央高校基本科研业务费资助(103.1.2E022050205)
【所属期刊栏目】 学术研究 (2011年10期)
  • 【DOI】10.16667/j.issn.2095-1302.2011.10.020
  • 【分类号】TN911.8;TN791
  • 【被引频次】3
  • 【下载频次】346
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